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基于FPGA的多相DDC设计与实现

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摘要摘要：雷达数字接收机中往往存在前端ADC输出的高速数据流与后端DSP的低吞吐率之间难以匹配的问题。因此，本文从工程角度出发，给出了一种基于现场可编程门阵列（FPGA，Field Programmable Gate Array）的数字下变频设计方案，通过对中频信号分为4相处理以及对FIR滤波器、NCO模块进行优化，在得到有效信号的同时可以节省部分资源。

DOI 2d3kk7ogj9/6920691

作者王聪

机构地区中国电子科技集团公司第二十研究所，陕西西安 710000

出处《科技新时代》 2023年2期

关键词 DDC FPGA FIR滤波器 NCO

分类 [][]

出版日期 2023年03月22日（中国期刊网平台首次上网日期，不代表论文的发表时间）

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